Searched refs:setVecReg (Results 1 - 13 of 13) sorted by relevance

/gem5/src/cpu/checker/
H A Dthread_context.hh361 setVecReg(const RegId& reg, const VecRegContainer& val) override
363 actualTC->setVecReg(reg, val);
364 checkerTC->setVecReg(reg, val);
H A Dcpu_impl.hh616 thread->setVecReg(idx, mismatch_val.asVector());
651 thread->setVecReg(idx, res.asVector());
H A Dcpu.hh398 thread->setVecReg(reg, val);
/gem5/src/cpu/o3/
H A Drename_map.cc217 regFile->setVecReg(regFile->getTrueId(&pregId), new_RF[i]);
H A Dregfile.hh330 setVecReg(PhysRegIdPtr phys_reg, const VecRegContainer& val) function in class:PhysRegFile
H A Ddyn_inst.hh404 this->cpu->setVecReg(this->_destRegIdx[idx], val);
H A Dthread_context.hh326 setVecReg(const RegId& reg, const VecRegContainer& val) override
H A Dcpu.cc1283 FullO3CPU<Impl>::setVecReg(PhysRegIdPtr phys_reg, const VecRegContainer& val) function in class:FullO3CPU
1286 regFile.setVecReg(phys_reg, val);
1426 setVecReg(phys_reg, val);
H A Dcpu.hh416 void setVecReg(PhysRegIdPtr reg_idx, const VecRegContainer& val);
/gem5/src/cpu/
H A Dthread_context.hh257 virtual void setVecReg(const RegId& reg, const VecRegContainer& val) = 0;
H A Dsimple_thread.hh482 setVecReg(const RegId &reg, const VecRegContainer &val) override
/gem5/src/cpu/minor/
H A Dexec_context.hh221 thread.setVecReg(reg, val);
/gem5/src/cpu/simple/
H A Dexec_context.hh246 thread->setVecReg(reg, val);

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