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H A Dstimgen.h62 const signal_bool_vector4& O1,
70 o1 (O1),
60 stimgen(sc_module_name NAME, sc_clock& TICK, const signal_bool_vector4& O1, const signal_bool_vector4& O2, const signal_bool_vector8& O3, const signal_bool_vector8& O4, const signal_bool_vector8& O5, signal_bool_vector8& IN1 ) argument
/gem5/src/systemc/tests/systemc/misc/if_transforms/loop_unrolling/pr476/
H A Dmonitor.h89 const sc_signal<int>& O1,
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/gem5/src/systemc/tests/systemc/misc/if_transforms/loop_unrolling/test2/
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96 cont3 (CONT3), o1(O1), o2(O2), o3(O3), o4(O4), o5(O5)
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/gem5/src/systemc/tests/systemc/misc/if_transforms/loop_unrolling/test3/
H A Dmonitor.h89 const sc_signal<int>& O1,
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H A Dtb.h89 const sc_signal<int>& O1,
96 cont3 (CONT3), o1(O1), o2(O2), o3(O3), o4(O4), o5(O5)
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/gem5/src/systemc/tests/systemc/misc/if_transforms/loop_unrolling/test4/
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96 cont3 (CONT3), o1(O1), o2(O2), o3(O3), o4(O4), o5(O5)
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H A Dtb.h89 const sc_signal<int>& O1,
96 cont3 (CONT3), o1(O1), o2(O2), o3(O3), o4(O4), o5(O5)
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96 cont3 (CONT3), o1(O1), o2(O2), o3(O3), o4(O4), o5(O5)
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/gem5/src/systemc/tests/systemc/misc/if_transforms/loop_unrolling/test5/
H A Dmonitor.h89 const sc_signal<int>& O1,
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96 cont3 (CONT3), o1(O1), o2(O2), o3(O3), o4(O4), o5(O5)
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96 cont3 (CONT3), o1(O1), o2(O2), o3(O3), o4(O4), o5(O5)
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/gem5/src/systemc/tests/systemc/misc/if_transforms/loop_unrolling/test6/
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H A Dtest.h94 sc_signal<int>& O1,
101 cont3 (CONT3), o1(O1), o2(O2), o3(O3), o4(O4), o5(O5)
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/gem5/src/systemc/tests/systemc/misc/synth/concat/fncall/
H A Dmonitor.h87 const sc_signal<int>& O1,
94 cont3 (CONT3), o1(O1), o2(O2), o3(O3), o4(O4), o5(O5)
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94 cont3 (CONT3), o1(O1), o2(O2), o3(O3), o4(O4), o5(O5)
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